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公司主營：西門子數控系統,V20變頻器S7-200CN.S7-200smart.S7-300.S7-400.S7-1200.6ES5 ET200 人機界面,變頻器,DP總線,MM420 變頻器MM430 變頻器MM
產品簡介
詳細介紹
PTO
逐步疊加工作，從而使隨時間呈線性變化。疊加到的恒定值的分辨率受到。該分辨率會在產生的中引入截斷誤差。因此，PTO
無法保證脈沖串可以到達為段的結束。在下圖中，可以看到截斷誤差會影響 PTO 加速。應該測量輸出，確定該是否在可接受的范圍內。
① 期望的曲線圖
② 實際的曲線圖
如果一段結束和下一段開始的差 (Δf)
是不可接受，請嘗試結束來對該差值進行補償。為使得輸出位于可接受的范圍內，可能需要反復進行這種。
注意，段參數改變會影響 PTO
完成的時間。可以使用段的時間等式（在下文介紹）來了解其對時間的影響。對于給定的段來說，要想準確的段時間，結束值或脈沖數必須具備一定的彈性。
上面的簡化示例用于介紹目的，實際應用可能需要更復雜的波形包絡。別忘了您只能分配整數形式的 Hz ，且必須以恒定速率執行更改。S7-200 SMART CPU
可選擇該恒定速率，且每一段的恒定速率可以不同。
對于依照周期時間（而非）的項目，可以使用以下公式來進行轉換：
CTFinal = CTInitial + (ΔCT * PC)
FInitial = 1 / CTInitial FFinal = 1 / CTFinal
其中：
CTInitial | 段啟動周期時間 (s) |
ΔCT | 段增量周期時間 (s) |
PC | 段內脈沖數量 |
CTFinal | 段結束周期時間 (s) |
FInitial | 段起始 (Hz) |
FFinal | 段結束 (Hz) |
給定 PTO
包絡段的加速度（或減速度）和時間有助于確定正確的包絡表值。使用以下公式可計算給定包絡的時間和加速度：
ΔF = FFinal - FInitial
Ts = PC / (Fmin + ( | ΔF | / 2 ) )
As = ΔF / Ts
其中：
Ts | 段時間 (s) |
As | 段加速度 (Hz/s) |
PC | 段內脈沖數量 |
Fmin | 段 (Hz) |
ΔF | 段增量（總變化） (Hz) |
7.4 數學
7.4.1 加法、減法、乘法和除法
LAD / FBD | STL | 說明 | ||
+I +D +R | IN1, IN1, IN1, | OUT OUT OUT | 加整數指令將兩個 16 位整數相加，產生一個 16 位結果。加雙精度整數指令將兩個 32 位整數相加，產生一個 32 位結果。加實數指令將兩個 32 位實數相加，產生一個 32 位實數結果。 | |
ADD_DI | · LAD 和 FBD：IN1 + IN2 = OUT | |||
ADD_R | · STL： IN1 + OUT = OUT | |||
-I -D -R | IN1, IN1, IN1, | OUT OUT OUT | 整數減法指令將兩個 16 位整數相減，產生一個 16 位結果。雙整數減法 (-D) 指令將兩個 32 位整數相減，產生一個 32 位結果。實數減法 (-R) 指令將兩個 32 位實數相減，產生一個 32 位實數結果。 | |
SUB_DI | · LAD 和 FBD：IN1 - IN2 = OUT | |||
SUB_R | · STL：OUT - IN1 = OUT | |||
*I *D *R | IN1, IN1, IN1, | OUT OUT OUT | 整數乘法指令將兩個 16 位整數相乘，產生一個 16 位結果。雙整數乘法指令將兩個 32 位整數相乘，產生一個 32 位結果。實數乘法指令將兩個 32 位實數相乘，產生一個 32 位實數結果。 | |
MUL_DI | · LAD 和 FBD：IN1 * IN2 = OUT | |||
MUL_R | · STL：IN1 * OUT = OUT | |||
/I /D /R | IN1, IN1, IN1, | OUT OUT OUT | 整數除法指令將兩個 16 位整數相除，產生一個 16 位結果。（不保留余數。）雙整數除法指令將兩個 32 位整數相除，產生一個 32 位結果。（不保留余數。）實數除法 (/R) 指令將兩個 32 位實數相除，產生一個 32 位實數結果。 | |
DIV_DI | · LAD 和 FBD：IN1/IN2 = OUT | |||
DIV_R | · STL：OUT / IN1 = OUT | |||
西門子模擬量模塊6ES7522-5EH00-0AB0合作商